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[主观题]

图13.11（a)所示是用JK触发器组成的双相时钟电路。若CP端加上时钟脉冲信号，在输出端可得到相位互相错开的时钟

图13.11(a)所示是用JK触发器组成的双相时钟电路。若CP端加上时钟脉冲信号，在输出端可得到相位互相错开的时钟信号A和B，试画出Q，图13.11（a)所示是用JK触发器组成的双相时钟电路。若CP端加上时钟脉冲信号，在输出端可得到相位和A，B的波形，假设触发器的初始状态为0。

图13.11（a)所示是用JK触发器组成的双相时钟电路。若CP端加上时钟脉冲信号，在输出端可得到相位

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发布时间：2024-03-29

更多“图13.11（a)所示是用JK触发器组成的双相时钟电路。若CP端加上时钟脉冲信号，在输出端可得到相位互相错开的时钟”相关的问题

第1题

由3个JK触发器组成的计数器如下图所示，试列出该计数器的状态表，画出工作波形图，说明其逻辑功能。

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第2题

试用边沿JK触发器设计一个时序逻辑电路,要求该电路的输出Z与CP之间的关系应满足图P5.7所示的波

形图.

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第3题

画出图P5.8(a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波形如

画出图P5.8（a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波形如

图P5.8(b)所示。设触发器的初始状态为Q=0。

画出图P5.8（a)中脉冲触发JK触发器输出端Q和Q'的电压波形。时钟脉冲CLK和输入J、K的电压波

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第4题

用JK触发器设计一个4位单向右移移位寄存器。

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第5题

用JK触发器设计一个同步六进制加1计数器。

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第6题

图P9.8（a)是用CMOS门电路和RC积分环节组成的积分型单稳态电路。试画出在图P9.8（b)所示输入脉冲作

图P9.8(a)是用CMOS门电路和RC积分环节组成的积分型单稳态电路。试画出在图P9.8(b)所示输入脉冲作用下υ₀₁、υ₁₂和υ₀的电压波形。假定触发脉冲的宽度大于输出脉冲的宽度。

图P9.8（a)是用CMOS门电路和RC积分环节组成的积分型单稳态电路。试画出在图P9.8（b)所示

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第7题

用JK触发器设计具有以下特点的计数器：（1)计数器有两个控制输入C1和C2，C1用以控制计数器的模数，C2用以控制

用JK触发器设计具有以下特点的计数器：

(1)计数器有两个控制输入C₁和C₂，C₁用以控制计数器的模数，C₂用以控制计数的增减；

(2)若C₁=0计数器的M=3；如果C₁=1，则计数器为M=4；

(3)若C₂=0，则为加法计数，若C₂=1，则为减法计数。作出状态表，并画出计数器逻辑图。

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第8题

一个数字系统控制单元的状态图如图题11.2.5所示，试画出等效的ASM图（状态框是空的)，并用D触发器

一个数字系统控制单元的状态图如图题11.2.5所示，试画出等效的ASM图(状态框是空的)，并用D触发器和数据选择器实现控制单元电路。

一个数字系统控制单元的状态图如图题11.2.5所示，试画出等效的ASM图（状态框是空的)，并用D触发

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第9题

题图13-2所示为两个“与或非”门构成的基本触发器，试写出其状态方程、真值表及状态转移图。

题图13-2所示为两个“与或非”门构成的基本触发器，试写出其状态方程、真值表及状态转移图。请帮忙给出

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第10题

仅具有“置0”、“置1”功能的触发器是

A.RS

B.JK

C.T

D.D

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第11题

试将JK触发器转换为D触发器。

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